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IDT70T3519/99/89S
High-Speed 2.5V 256/128/64K x 36 Dual-Port Synchronous Static RAM
Industrial and Commercial Temperature Ranges
Timing Waveform of Flow-Through Read-to-Write-to-Read ( OE = V IL ) (2)
t CYC1
CLK
CE 0
t CH1
t CL1
CE 1
t SC
t SB
t HC
t HB
BE n
t SW t HW
R/ W
t SW t HW
(3)
ADDRESS
An
An +1
An + 2
An + 2
An + 3
An + 4
t SA
t HA
t SD t HD
DATA IN
Dn + 2
DATA OUT
(1)
t CD1
Qn
t DC
t CD1
Qn + 1
t CKHZ
t CD1
t CKLZ
t CD1
Qn + 3
t DC
READ
NOP
(5)
WRITE
READ
5666 drw 13
Timing Waveform of Flow-Through Read-to-Write-to-Read ( OE Controlled) (2)
t CYC1
CLK
CE 0
t CH1
t CL1
CE 1
t SC
t SB
t HC
t HB
BE n
t SW t HW
R/ W
t SW t HW
ADDRESS
(3)
An
An +1
An + 2
An + 3
An + 4
An + 5
t SA
t HA
t SD t HD
DATA IN
(1)
t CD1
t DC
Dn + 2
Dn + 3
t OE
t CD1
t CD1
DATA OUT
Qn
Qn + 4
OE
t OHZ
t CKLZ
t DC
NOTES:
READ
WRITE
READ
5666 drw 14
1. Output state (High, Low, or High-impedance) is determined by the previous cycle control signals.
2. CE 0 , BE n, and ADS = V IL ; CE 1 , CNTEN , and REPEAT = V IH .
3. Addresses do not have to be accessed sequentially since ADS = V IL constantly loads the address on the rising edge of the CLK; numbers are for
reference use only.
4. "NOP" is "No Operation." Data in memory at the selected address may be corrupted and should be re-written to guarantee data integrity.
17
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